Microchip Technology ZL30671LFG7 Systemsynchronisator
Der Systemsynchronizer ZL30671LFG7 von Microchip Technology bietet eine 1-, 2- oder 3-Kanal-Synchron-Ethernet (SyncE) Pakettaktsynchronisation. Mit der miTimePLL-Timing-Technologie ist dieses Bauteil für 5G-Transport- und Drahtlosinfrastrukturgeräte optimiert. In dem Bauteil sind alle Funktionen integriert, die für eine Timing Card PLL und eine Line Card PLL erforderlich sind. Durch die hohe Integration und den extrem niedrigen Jitter ist dieser Synchronisator ideal für den Einsatz in chassisbasierten Systemen mit aktiven und redundanten Timing-Karten. Das Modul eignet sich für Single-Board-Applikationen, bei denen ein Timing-Bauteil sowohl die Eigenschaften einer Timing-Karte als auch die einer Line-Card-PLL aufweisen muss. Der Microchip Technology ZL30671LFG7 System Synchronizer ist in einem LGA-80-Gehäuse mit einem Betriebstemperaturbereich von -40°C bis +85°C erhältlich.
Merkmale
- Ein, zwei oder drei DPLL-Kanäle
- Timing-Übereinstimmung mit ITU-T 8262, G.813, G.812, G.8273.2; Telcordia GR-1244, GR-253
- Programmierbare Bandbreite, 1 MHz bis 470 Hz
- Freerun oder Holdover bei Verlust aller Eingänge
- Berührungslose Referenzschaltung
- Hochauflösende Holdover-Mittelung
- Phasenanpassung je DPLL, Auflösung 1 ps
- Programmierbarer Tracking-Bereich, Begrenzung der Phasensteigung, Begrenzung der Frequenzänderung und andere erweiterte Funktionen
- Lokaler Oszillator
- Betrieb mit einem einzigen TCXO oder OCXO: 23,75 MHz bis 25 MHz, 47,5 MHz bis 50 MHz, 114,285 MHz bis 125 MHz
- Applikationen mit sehr geringem Jitter können einen TCXO oder OCXO als Stabilitätsreferenz und einen XO mit geringem Jitter als Jitter-Referenz anschließen
- Erzeugung der Ausgangstaktfrequenz
- Beliebige Ausgangsfrequenz von <0,5 Hz bis 1045 MHz (180 MHz max. für Synth0)
- Hochauflösende fraktionale Frequenzumwandlung mit 0ppm Fehler
- Die Synthesizer 1 und 2 haben einen ganzzahligen und einen gebrochenen Teiler, so dass insgesamt 5 Frequenzfamilien zur Verfügung stehen.
- Der Ausgangsjitter von Synth 1 und 2 beträgt <0,3 ps RMS
- Der Ausgangsjitter von Fractional Dividers ist typischerweise < 1 ps RMS, bei vielen Frequenzen <0,5 ps RMS
- Jedes HPOUTP/N-Paar kann LVDS, LVPECL, HCSL, 2xCMOS, HSTL oder ein programmierbares Diff. sein.
- Im 2xCMOS-Modus können die P- und N-Pins unterschiedliche Frequenzen haben (Beispiel: 125 MHz und 25 MHz)
- Vier Ausgangsbänke mit jeweils einem VDDO -Pin; CMOS-Ausgangsspannungen von 1,5 V bis 3,3 V
- Phaseneinstellung je Synthesizer, 1 ps Auflösung
- Programmierbares Tastverhältnis je Ausgang
- Präzise Schaltung zur Ausrichtung des Ausgangs und Einstellung der Phase je Ausgang
- Freigabe/Deaktivierung je Ausgang und störungsfreier Start/Stopp (Stopp hoch oder niedrig)
- Eingangstakte
- Für bis zu 10 differentielle oder CMOS-Eingänge ausgelegt
- Beliebige Eingangsfrequenz von 5 Hz bis 900 MHz
- Überwachung von Aktivität und Frequenz je Eingang
- Automatische oder manuelle Referenzschaltung
- Reversive oder nicht-reversive Schaltung
- Jeder Eingang kann ein 1PPS SYNC-Eingang für REF+SYNC-Frequenz-/Phasen-/Zeitverriegelung sein
- Eingang-Eingang-Phasenmessung, 1 ps Auflösung
- Eingang-DPLL-Phasenmessung, 1 ps Auflösung
- Phaseneinstellung je Eingang, Auflösung 1 ps
- Allgemeine Merkmale
- Automatische Selbstkonfiguration beim Einschalten aus dem internen Flash-Speicher
- Eingang-zu-Ausgang-Abgleich <200 ps (ext. Rückkopplung)
- Schnelle REF+SYNC-Verriegelung für Frequenz- und 1-PPS-Phasenabgleich mit kostengünstigerem Oszillator
- Interne Kompensation (1 ppt) für Lokaloszillator-Frequenzfehler in DPLLs und Eingangsmonitoren
- Numerisch gesteuertes Oszillatorverhalten in jeder DPLL und jedem fraktionalen Ausgangsteiler
- Ein einfach zu konfigurierendes Design erfordert keine externen VCXO- oder Schleifenfilter-Komponenten
- 7 GPIO-Pins mit vielen möglichen Verhaltensweisen
- SPI- oder I2C-Prozessorschnittstelle
- 1,8 V und 3,3 V Core-VDD-Spannungen
- Leistung: 3 W für 2 Eingänge, 1 Synth, 6 LVDS-Ausgänge
- Betriebstemperaturbereich: -40 °C bis +85 °C
- LGA-80-Gehäuse: 11 mm x 11 mm
- Bleifrei
Applikationen
- Zentrale System-Timing-ICs für SyncE, SyncE+1588, SONET/SDH, OTN, drahtlose Basisstationen und andere Carrier-Grade-Systeme
- 8262/813 EWG/SEK, Telcordia Stratum 2-4
Blockdiagramm
Applikationsbeispiel
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Veröffentlichungsdatum: 2022-05-16
| Aktualisiert: 2023-03-16