SN65LVDS301ZXHR

Texas Instruments
595-SN65LVDS301ZXHR
SN65LVDS301ZXHR

Herst.:

Beschreibung:
Serialisierer & Deserialisierer - Serdes Programmable 27-bit display serial inter A 595-SN65LVDS301ZXH

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CHF -.--
Erw. Preis:
CHF -.--
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Gehäuse:
Ganzes Reel (Sie bestellen ein Vielfaches von 2500)

Preis (CHF)

Menge Stückpreis
Erw. Preis
Gurtabschnitt / MouseReel™
CHF 3.92 CHF 3.92
CHF 2.98 CHF 29.80
CHF 2.75 CHF 68.75
CHF 2.49 CHF 249.00
CHF 2.36 CHF 590.00
CHF 2.29 CHF 1 145.00
CHF 2.23 CHF 2 230.00
Ganzes Reel (Sie bestellen ein Vielfaches von 2500)
CHF 2.08 CHF 5 200.00
† Für die MouseReel™ wird Ihrem Warenkorb automatisch eine Gebühr von CHF 7.00 hinzugefügt. MouseReel™ Bestellungen sind weder stornierbar, noch können sie zurückgegeben werden.

Alternativverpackung

Herst. Teilenr.:
Verpackung:
Tray
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Auf Lager
Preis:
CHF 3.92
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1

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Texas Instruments
LVDS-IC-Schnittstelle Programmable 27-bit display serial inter A 595-SN65LVDS301ZXHR

Produktattribut Attributwert Attribut auswählen
Texas Instruments
Produktkategorie: Serialisierer & Deserialisierer - Serdes
RoHS:  
Serializer
1.755 Gb/s
LVDS
CMOS
27 Output
1.95 V
1.65 V
- 40 C
+ 85 C
SMD/SMT
NFBGA-80
Reel
Cut Tape
MouseReel
Marke: Texas Instruments
Entwicklungs-Kit: SN65LVDS301 IBIS
Feuchtigkeitsempfindlich: Yes
Betriebsversorgungsstrom: 200 nA
Betriebsversorgungsspannung: 1.8 V
Pd - Verlustleistung: 44.5 mW
Produkt: Serializers
Produkt-Typ: Serializers & Deserializers - Serdes
Serie: SN65LVDS301
Verpackung ab Werk: 2500
Unterkategorie: Interface ICs
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Ausgewählte Attribute: 0

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USHTS:
8542390090
ECCN:
EAR99

SN65LVDS301 27-Bit-Parallel-zu-Seriell-Sender

Das Texas Instruments SN65LVDS301 programmierbare 27-Bit-Parallel-zu-Seriell-Sender-Bauteil wandelt 27 parallelgeschaltete Dateneingänge in 1, 2 oder 3 serielle Sub-Differential-Signalausgänge (SubLVDS) um. Es lädt ein Schieberegister mit 24-Pixel-Bits und drei Steuerbits von der parallelgeschalteten CMOS-Eingangschnittstelle. Zusätzlich zu den 27 Datenbits fügt das Bauteil ein Paritätsbit und zwei reservierte Bits zu einem 30-Bit-Datenwort hinzu. Der Pixeltaktgeber (PCLK) hält jedes Wort im Gerät fest. Das Paritätsbit (ungerade Parität) ermöglicht es einem Empfänger die Erkennung von Einzelbitfehlern. Das serielle Schieberegister wird je nach Anzahl der verwendeten seriellen Verbindungen mit dem 30-, 15- oder 10-fachen der Pixeltakt-Datenrate hochgeladen. Eine Kopie des Pixeltaktgebers wird als separater Differenzausgang ausgegeben.