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TMS320VC5506PGE

Name: Texas Instruments TMS320VC5506PGE
Brand: Texas Instruments
SKU: 595-320VC5506PGE
Price: 13.28 CHF
Availability: OutOfStock

Bilder dienen lediglich der Veranschaulichung und sind nicht Originalgetreu
Siehe Produktspezifikationen

Mouser-Nr.:

595-320VC5506PGE

Herst.- Nr.:

TMS320VC5506PGE

Herst.:

Texas Instruments

Beschreibung:

Digitale Signalprozessoren und Controller - DSP, DSC Fixed-Point DSP

Datenblatt:

TMS320VC5506PGE Datenblatt

ECAD Model:

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Hersteller:	Texas Instruments
Produktkategorie:	Digitale Signalprozessoren und Controller - DSP, DSC
RoHS:
Produkt:	DSPs
Kern:	C55x
Anzahl der Kerne:	1 Core
Maximale Taktfrequenz:	108 MHz
Verpackung/Gehäuse:	LQFP-144
Programmspeichergröße:	64 kB
RAM-Datengröße:	128 kB
Betriebsversorgungsspannung:	1.2 V
Serie:	TMS320VC5506
Montageart:	SMD/SMT
Minimale Betriebstemperatur:	- 40 C
Maximale Betriebstemperatur:	+ 85 C
Verpackung:	Tray
Marke:	Texas Instruments
Datenbus-Weite:	16 bit
Anleitungsart:	Fixed Point
Feuchtigkeitsempfindlich:	Yes
Anzahl der I/Os:	8 I/O
Produkt-Typ:	DSP - Digital Signal Processors & Controllers
Art des Programmspeichers:	Asynchronous SRAM, EPROM, Synchronous SDRAM, SBSRAM
Verpackung ab Werk:	60
Unterkategorie:	Embedded Processors & Controllers
Gewicht pro Stück:	1.290 g

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TMS320VC5506PGE Datenblatt

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Images

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TMS320VC5506 Digitaler Festpunkt-Signalprozessor

Der Texas Instruments TMS320VC5506 digitale Festpunkt-Signalprozessor (DSP) basiert auf dem TMS320C55x DSP-Generierungs-CPU-Prozessorkern. Die DSP-Architektur von Texas Instruments TMS320C55x erreicht hohe Leistung und geringen Stromverbrauch durch erhöhte Parallelität und den Fokus auf die Reduzierung der Verlustleistung. Die CPU unterstützt eine interne Busstruktur, die aus einem Programmbus, drei Lese-Datenbusse, zwei Schreib-Datenbusse und weiteren Bussen für Peripherie- und DMA-Aktivitäten besteht. Diese Busse bieten in einem einzigen Zyklus die Möglichkeit, bis zu drei Datenlesungen und zwei Datenschreibungen auszuführen. Parallel dazu kann der DMA-Controller bis zu zwei Datenübertragungen pro Zyklus durchführen, unabhängig von der CPU-Aktivität.