CDCU877RHATG4

Texas Instruments
595-CDCU877RHATG4
CDCU877RHATG4

Herst.:

Beschreibung:
Takttreiber u. -verteiler 1.8v PLL Clock Drive r ALT 595-CDCU877RH ALT 595-CDCU877RHAT

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Produktattribut Attributwert Attribut auswählen
Texas Instruments
Produktkategorie: Takttreiber u. -verteiler
RoHS:  
VQFN-40
CDCU877
- 40 C
+ 85 C
Reel
Marke: Texas Instruments
Feuchtigkeitsempfindlich: Yes
Montageart: SMD/SMT
Produkt: Clock Drivers
Produkt-Typ: Clock Drivers & Distribution
Verpackung ab Werk: 250
Unterkategorie: Clock & Timer ICs
Typ: Phase-Locked-Loops (PLLs) and Oscillators
Gewicht pro Stück: 104 mg
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Ausgewählte Attribute: 0

                        
The G4 and E4 suffixes were added for ROHS conversion. The
G4 and E4 parts are exactly the same as the original parts
without the G4 or E4 suffix.

For lead-frame-based devices, the RoHS-compliant solution
is backward-compatible with lead-based processes; so the
same part is shipped regardless of whether a unique part
number or a standard part number is ordered.

Lead-frame-based unique part numbers will consist of the
standard part number plus a two-character suffix (usually
E4 or G4, sometimes E3, E6, G3 or G6).

"E" = RoHS-compliant

"G" = Green (RoHS-compliant and no Br/Sb)

Please contact a Mouser Technical Sales Representative for
further information.


5-1011-9

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CNHTS:
8542319090
CAHTS:
8542390000
USHTS:
8542390090
JPHTS:
8542390990
TARIC:
8542399000
MXHTS:
85423999
ECCN:
EAR99

CDCU877 Phasenregelschleifen-Takttreiber

Der Texas Instruments CDCU877 Phasenverriegelungs-Loop-Takttreiber ist ein leistungsstarker Buffer mit geringem Jitter, geringem Versatz und Null-Verzögerung. Das Bauteil verteilt ein Differential-Takteingangspaar (CK, /CK) auf 10 differentielle Paare von Taktausgängen (Yn, /Yn) und ein differentielles Paar von Rückkopplungs-Taktausgängen (FBOUT, /FBOUT). Die Taktausgänge werden durch die Eingangstaktgeber (CK, /CK), die Rückkopplungstaktgeber (FBIN, /FBIN), die LVCMOS-Steuerpins (OE, OS) und den analogen Stromeingang (AVDD) gesteuert. Wenn OE niedrig ist, sind die Taktausgänge, außer FBOUT, /FBOUT deaktiviert, während die interne PLL seine verriegelte Frequenz aufrechterhält. OS (Output Select) ist ein Programmpin, der an GND oder VDD angeschlossen werden muss. Wenn OS hoch ist, funktioniert OE wie zuvor beschrieben. Wenn OS und OE beide niedrig sind, wirkt sich OE nicht auf Y7, /Y7 aus, da diese freilaufend sind. Wenn AVDD geerdet ist, ist die PLL ausgeschaltet und wird zu Testzwecken überbrückt.