AS4C128M32MD2A-25BIN

Alliance Memory
913-4C12832MD2A25BIN
AS4C128M32MD2A-25BIN

Herst.:

Beschreibung:
DRAM LPDDR2, 4G, 128M X 32, 1.2V, 134 BALL BGA, 400MHZ, Industrial TEMP - Tray

Datenblatt:
ECAD Model:
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Menge Stückpreis
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15.60 CHF 15.60 CHF
14.48 CHF 144.80 CHF
14.01 CHF 350.25 CHF
13.68 CHF 684.00 CHF
13.08 CHF 1 308.00 CHF
12.75 CHF 2 142.00 CHF
12.56 CHF 6 330.24 CHF

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Alliance Memory
Produktkategorie: DRAM
RoHS:  
SDRAM Mobile - LPDDR2
4 Gbit
32 bit
400 MHz
FBGA-134
128 M x 32
5.5 ns
1.14 V
1.95 V
- 40 C
+ 85 C
AS4C128M32MD2A-25
Tray
Marke: Alliance Memory
Feuchtigkeitsempfindlich: Yes
Montageart: SMD/SMT
Produkt-Typ: DRAM
Verpackung ab Werk: 168
Unterkategorie: Memory & Data Storage
Versorgungsstrom - Max.: 130 mA
Gewicht pro Stück: 2,191 g
Produkte gefunden:
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Ausgewählte Attribute: 0

Datenblatt

Konformitätscodes
CNHTS:
8542329010
CAHTS:
8542320020
USHTS:
8542320036
MXHTS:
8542320201
ECCN:
EAR99
Ursprungsklassifikationen
Ursprungsland:
Taiwan
Herstellungsland:
Taiwan
Land der Verbreitung:
Taiwan
Zum Zeitpunkt der Lieferung kann sich das Land ändern.

DDR2 SDRAM

Alliance Memory DDR2 SDRAM is designed to comply with DDR2 SDRAM key features. Features such as posted CAS# with additive latency, Write latency=Read latency -1, and On-Die Termination (ODT). All of the control and address inputs are synchronized with a pair of externally supplied differential clocks. Inputs are latched at the cross point of differential clocks (CK rising and CK# falling). All I/Os are synchronized with a pair of bidirectional strobes (DQS and DQS#) in a source synchronous fashion. The address bus is used to convey row, column, and bank address information in RAS #, CAS# multiplexing style.

Stromsparender DDR2-SDRAM

Alliance stromsparende DDR2-SDRAM-Speicher sind Hochgeschwindigkeits-CMOS- und Dynamic-Access-Speicher, die intern als 8-Bank-Speicher konfiguriert sind. Diese DDR2-SDRAM verfügen über 4-Bit-Prefetch-DDR-Architektur, programmierbare Lese- und Schreib-Latenzen, automatische temperaturkompensierte Selbstauffrischung (TCSR) und Taktstopp-Fähigkeit. Der DDR2-SDRAM reduziert die Anzahl der Eingangspins im System durch Verwendung einer Architektur mit doppelter Datenrate auf dem Befehls-/Adressbus (CA-Bus). Diese CA-Bus dient zur Übertragung von Adress-, Befehls- und Bankdaten. Dieser DDR2-SDRAM kann einen Hochgeschwindigkeitsbetrieb erreichen, indem eine Architektur mit doppelter Datenrate an den DQ-Pins (bidirektionaler/differenzieller Datenbus) verwendet wird.

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